VHDL

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Getting started: Test benching MyHDL con ISE Simulator
Elettronica

Getting started: Test benching MyHDL con ISE Simulator

This phase is as important as the design phase, and as a general rule, the amount of time spent simulating should be about twice the design time. Gina R. Smith, FPGA designer Un sistema descritto in VHDL viene solitamente simulato per analizzarne il comportamento, stimolando i possibili ingressi e verificando
18 set 2017 • 5 min read
Getting Started: FPGAs Hello World!
Elettronica

Getting Started: FPGAs Hello World!

L’intento di questo articolo non  é  di fornire  una guida al VHDL,  ma un workflow dallo schematico al bitstream attraverso l’ISE Design Suite di Xilinx rispondendo alle domande di chi compra un nuovo FPGA e non sa da dove iniziare. Registratevi al sito Xilinx e createvi un account
20 dic 2015 • 9 min read
Getting started: Design di un Perceptron in FPGA con Vivado
Artificial Neural Network

Getting started: Design di un Perceptron in FPGA con Vivado

In questo articolo per la rivista Elettronica Open Source  avevamo già visto sia la teoria sia la pratica su come realizzare un modello con Simulink (Matlab) e System Generator di una semplice rete neurale artificiale (ANN) perceptron e come eseguirne l’addestramento con NNTOOL. Seguendo un procedimento analogo possiamo implementare
15 lug 2014 • 6 min read